Name: Prototypage Rapide des Systèmes Numériques : Quartus (R) II Édition
Brand: Altera
SKU: 7GRG4D8U3NNR
Price: 88.95 CAD
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Prototypage Rapide des Systèmes Numériques : Quartus (R) II Édition

Protection rapide des systèmes numériques : Quartus (R) II Edition

Format de livre

Nombre de pages

Édition

Éditeur

<p></p><br/><p>Protection rapide des systèmes numériques : Quartus II Edition offre un composant de laboratoire excitant et stimulant pour les cours de conception numérique et informatique de premier plan utilisant des FPGA et des outils de CAO pour la simulation et la mise en œuvre matérielle. Les sujets et exercices plus avancés rendent également ce texte utile pour les cours de niveau supérieur en logique numérique, logique programmable et systèmes intégrés. Cette nouvelle version du largement utilisé Rapid Prototyping of numérique Systems, deuxième édition, utilise maintenant le nouvel outil CAO Quartus II d'Altera et inclut des projets de laboratoire pour le UP 2 d'Altera et le nouveau tableau UP 3 FPGA.</p><br/><p>Prototypage rapide des systèmes numériques : Quartus II Edition comprend quatre tutoriels sur les outils Altera Quartus II et NIOS II, un aperçu de la logique programmable et des cœurs IP avec plusieurs fonctions d'entrée et de sortie faciles à utiliser. Ces fonctionnalités ont été développées pour aider les étudiants à démarrer rapidement. Les premiers exemples de conception utilisent la capture schématique et des cœurs IP développés pour les cartes Altera UP FPGA. VHDL est utilisé pour des conceptions plus complexes après une courte introduction à la synthèse basée sur VHDL. Nouveau dans cette édition, voici un aperçu de la technologie System-on-a-Programmable Chip (SOPC) et des exemples de conception SOPC pour le UP3 utilisant le nouveau matériel et les outils de développement de logiciels NIOS II et C d'Altera.</p><br/><p>Tutoriel I : Le Design de 15 Minutes.- La Carte Altera UP 3.- Technologie Logique Programmable.- Tutoriel II : Design Séquentiel et Hiérarchie.- Fonctions de Bibliothèque UP3core.- Utilisation de VHDL pour la Synthèse de Matériel Numérique. Utilisation de Verilog pour la synthèse du matériel numérique.- Conception de la machine d'état : le contrôleur de train électrique.- Une conception informatique simple : la génération d'affichage vidéo VGA.- Interface avec le clavier et la souris PS/2.- Normes d'interfaçage I/O numériques Legacy.- Projets de robotique UP3.- Une conception RISC : synthèse du cœur du processeur MIPS.- Présentation de la puce programmable système sur programme.- Tutorial III : développement de logiciel du processeur NIOS II.- Tutorial IV : NIOS II Conception matérielle du processeur.- Annexe A : Génération de séquences binaires aléatoires Pseudo.- Annexe B : Conception Quartus II et extensions de fichiers de données.- Annexe C : Attributs UP 3 broches.- Annexe D : Code de caractère ASCII.- Annexe E : Programmation de la mémoire flash UP 3.</p>

Auteur

ISBN-13

Date de parution

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